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應用於標準元件與印刷電路板設計之繞線技術研究

為了解決dr.speed mac的問題，作者林世庭 這樣論述：

繞線於積體電路設計中為一必要且被廣泛應用的階段，隨著製程不斷演進，大量的訊號數量與複雜的設計規範大幅提高了繞線問題的複雜度。現今已有許多電子設計自動化(EDA)的工具與演算法被提出來克服複雜的晶片層級繞線，不過仍有一些重要的繞線問題是現存的演算法難以跟人工繞線產出近似的品質的，如標準元件繞線與印刷電路板繞線，這會導致工程師需花費大量時間與精力來完成這些繞線工作。因此，此論文擬提出許多的繞線方法以產出就算與人工繞線相比亦具有競爭力的繞線結果。因此，我們將提出之方法分為兩大主題，自動化標準元建合成與印刷電路板繞線。於自動化的標準元件合成，我們提出了第一個可以全自動合成標準元件庫並考慮drain-

to-drain abutment (DDA)於7奈米鰭式場效電晶體，我們首先提出基於動態規劃演算法的考慮DDA之電晶體擺放方法，並提出基於整數線性規劃之最佳化金屬第0層(M0)規劃演算法以降低第1金屬層(M1)的繞線擁擠度，所以標準元件的輸出入接點(I/O pin)的接入能力也因第2金屬層(M2)的使用量減少而提高。另一方面，我們分析有兩個主要原因導致自動化的標準元件繞線難以跟人工繞線產出近似的品質，其一為自動化的繞線難以完全使用元件中的空間，另外一個原因是以往的標準元件繞線研究並沒有考慮電容耦合所帶來的效能影響。因此，我們提出可隱式動態調整之繞線圖來繞線可以提高繞線資源的使用，我們也將考慮

電容耦合的繞線演算法轉成二次式規劃的方城組來最佳化標準元件的效能。實驗結果證實我們的標準元件庫不只可以幫助減少晶片的面積達5.73%，亦可以提供具有更好的面積與效能的標準元件。多行高的標準元件架構已在現今的設計中越來越流行，但卻沒有被以往的研究完整的討論，在此論文中，我們提出一個完整的擺放與繞線流程與方法以合成多行高的標準元件。我們提出一個基於A*搜尋演算法的多行高電晶體擺放方法以最佳化內行與跨行的連接能力，我們亦提出第一個基於最大化可滿足(Max-SAT)演算法的細部繞線器，其可以最佳化連接線長並滿足基本的設計規範。實驗結果證實我們所合成的標準元件與目前先進的單行標準元件具有近似的品質，且因

我們的多行高標準元件具有較好的長寬比，所以可以在合成晶片時具有更好的彈性。最後，因為越來越高的接點密度與繞線層數，印刷電路板繞線變得越來越複雜。印刷電路板繞線可分為兩個階段，逃離繞線與區域繞線。傳統的逃離繞線只專注於讓接點之連線逃離該晶片區塊，但未考慮其逃離位置對於晶片繞線的可繞度之影響。在此論文中，我們提出了一個完整的印刷電路板繞線流程與方法，其包含了同時性逃離繞線、後繞線最佳化、與區域繞線，而我們所提之印刷電路板繞線可以完成七個目前商業用印刷電路板繞線軟體無法完成的業界印刷電路板設計。 另外，在考慮業界提供之可製造性規範後，我們所提出的逃離繞線依然可以在加入額外設計的方城組後完成所有業界提

供的設計

中國大陸「一帶一路」倡議在東南亞地區的地緣經濟布局—亞洲基礎設施投資銀行的戰略角色與功能

為了解決dr.speed mac的問題，作者周淑傑 這樣論述：

2013年中國大陸國家主席習近平提出「一帶一路」倡議，打造大陸與世界聯通計畫，其中的「21世紀海上絲綢之路」與東南亞地區發展息息相關，再加上其與東協自由貿易區、東協經濟共同體和區域全面經濟夥伴協定等經濟合作機制，並緩和與區域國家間的島礁爭議，爭取相關國家的支持，進而穩定區域海上及陸上邊疆的政治環境，透由陸路和海上絲路匯集東南亞地區，探究區域國家參與該倡議對接國家發展政策，以及加入由中國大陸主導成立的亞洲基礎設施投資銀行，進而瞭解其戰略角色與功能。 本研究透過新古典現實主義途徑，從國際體系、國內政治及領導者認知等因素，綜合分析中國大陸區域「一帶一路」倡議推展和區域國家轉趨扈從或避險的戰略

選項，研究發現，中國大陸面臨國際環境權力競逐和國內經濟發展減緩等壓力，且習氏意欲尋求連任之企圖，藉由國家間發展政策之藍圖擘劃和提供基礎設施建設所需融資貸款，吸引開發中國家參與，以因應中國大陸國內、外政治情勢和經濟願景等挑戰，促使亞洲聯通計畫具體成形。即使面對美、日、印等國發起反制抗衡，藉由「亞投行」的否決權行使，仍可掌控區域經濟合作發展之主導權和話語權。